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Électrotechnique

logique positive

Anglais: positive logic

L'utilisation du niveau de tension le plus élevé pour représenter la valeur booléenne 1 et du niveau de tension le plus bas pour représenter la valeur booléenne 0. Par exemple, ~5V est égal à 1 logique, et ~0V est égal à 0 logique.

logique positive: tension haute signifie vrai

La logique positive est une convention où le plus élevé des deux niveaux de tension représente un booléen 1 (vrai), et le niveau le plus bas représente un 0 (faux). Dans les circuits TTL fonctionnant à 5 volts, un signal proche de 5V est lu comme 1, tandis qu'un signal proche de 0V est lu comme 0. Dans les systèmes CMOS modernes fonctionnant à 3,3V ou moins, la même règle s'applique: la tension du rail d'alimentation signifie 1, la masse signifie 0. C'est la norme dominante en électronique numérique car elle s'aligne naturellement avec le fonctionnement des interrupteurs à transistors et la distribution des alimentations.

L'alternative est la logique négative, où la tension la plus basse représente 1 et la tension la plus élevée représente 0. La logique négative apparaît dans certaines applications spécialisées, en particulier dans les conceptions plus anciennes et dans les circuits où les signaux inversés sont plus pratiques. Cependant, l'industrie privilégie fortement la logique positive car le mélange de conventions dans un même système crée de la confusion et nécessite une documentation explicite. Lorsqu'un ingénieur fait référence à des niveaux logiques sans qualification, la logique positive est supposée.

Marges de tension et immunité au bruit

Les circuits réels ne fonctionnent pas précisément à 0V et 5V. Les puces TTL définissent un logique 1 comme toute tension supérieure à 2,4V, et un logique 0 comme toute tension inférieure à 0,4V. La région entre 0,4V et 2,4V est indéfinie et produira un comportement imprévisible. Cette zone morte existe parce que les sorties des transistors ont une vitesse de commutation finie et que les effets de charge créent des tensions intermédiaires pendant les transitions. L'écart entre le niveau maximum de 0V (0,4V) et le niveau minimum de 1V (2,4V) est la marge de bruit, un tampon qui permet au signal de tolérer les interférences et d'être toujours reconnu correctement. La logique CMOS a des marges plus larges et une meilleure immunité au bruit que le TTL.

Le nom de logique «positive» fait référence au fait qu'une tension plus positive (potentiel plus élevé) encode la valeur booléenne affirmative. Cela la distingue linguistiquement et fonctionnellement de la logique négative, où la tension moins positive a cette signification. Le terme est standard dans les manuels et les fiches techniques, bien que dans la conversation technique quotidienne, les ingénieurs disent souvent simplement «haut signifie 1» ou se réfèrent au niveau actif d'un signal spécifique sans invoquer la terminologie formelle.

Lors de la conception de systèmes qui mélangent des familles logiques ou fonctionnent sur différents domaines de tension, le choix de la logique positive ou négative affecte l'inversion du signal, les configurations de pull-up et pull-down, et le comportement des sorties à drain ouvert. La plupart des flux de conception modernes utilisent par défaut la logique positive, ce qui simplifie l'analyse et réduit le risque de bogues subtils. La violation de cette convention est une source d'erreurs coûteuses dans les conceptions mixtes et FPGA.

Sources

Entrée IG332822/12/2008

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